工程中心-軟硬件調(diào)試(FPGA方向)
1元以上
大連
應(yīng)屆畢業(yè)生
學(xué)歷不限
大連
應(yīng)屆畢業(yè)生
學(xué)歷不限
- 全勤獎(jiǎng)
- 節(jié)日福利
- 不加班
- 周末雙休
職位描述
該職位還未進(jìn)行加V認(rèn)證,請(qǐng)仔細(xì)了解后再進(jìn)行投遞!
軟硬件調(diào)試:FPGA方向
技術(shù)要求
1.熟悉Verilog或VHDL語言、MATLAB語言;
2.能夠依據(jù)GJB 9433-2018或GB/T 33783-2017標(biāo)準(zhǔn)對(duì)FPGA軟件進(jìn)行測試,具有FPGA軟硬件及系統(tǒng)測試項(xiàng)目經(jīng)驗(yàn),具備國產(chǎn)FPGA測試經(jīng)驗(yàn)優(yōu)先,能夠進(jìn)行設(shè)計(jì)檢查、功能仿真、時(shí)序仿真、靜態(tài)時(shí)序分析、實(shí)物測試;
3.本科以上學(xué)歷,熟悉主流FPGA芯片開發(fā)流程及相關(guān)開發(fā)調(diào)試軟件,例如Quartus、Vivado、Modelsim等。
4.熟練掌握Vivado、ISE、Quartus II等常用的EDA 工具,ModelSim和QuestaSim等仿真測試工具,HDL Designer等規(guī)則檢查工具;
5.熟練掌握測試文檔(測試大綱、測試說明、測試用例、測試報(bào)告、問題報(bào)告)的編寫;
6.深入了解FPGA器件資源及使用方法,了解常用通信等協(xié)議以及校驗(yàn)算法,具備一定的電路基礎(chǔ);
7.熟悉常用測試儀器設(shè)備的使用,例如:萬用表、示波器、信號(hào)發(fā)生器、邏輯分析儀等;
8.具有良好的溝通能力,團(tuán)隊(duì)協(xié)作能力,對(duì)待事情認(rèn)真負(fù)責(zé)專注;
技術(shù)要求
1.熟悉Verilog或VHDL語言、MATLAB語言;
2.能夠依據(jù)GJB 9433-2018或GB/T 33783-2017標(biāo)準(zhǔn)對(duì)FPGA軟件進(jìn)行測試,具有FPGA軟硬件及系統(tǒng)測試項(xiàng)目經(jīng)驗(yàn),具備國產(chǎn)FPGA測試經(jīng)驗(yàn)優(yōu)先,能夠進(jìn)行設(shè)計(jì)檢查、功能仿真、時(shí)序仿真、靜態(tài)時(shí)序分析、實(shí)物測試;
3.本科以上學(xué)歷,熟悉主流FPGA芯片開發(fā)流程及相關(guān)開發(fā)調(diào)試軟件,例如Quartus、Vivado、Modelsim等。
4.熟練掌握Vivado、ISE、Quartus II等常用的EDA 工具,ModelSim和QuestaSim等仿真測試工具,HDL Designer等規(guī)則檢查工具;
5.熟練掌握測試文檔(測試大綱、測試說明、測試用例、測試報(bào)告、問題報(bào)告)的編寫;
6.深入了解FPGA器件資源及使用方法,了解常用通信等協(xié)議以及校驗(yàn)算法,具備一定的電路基礎(chǔ);
7.熟悉常用測試儀器設(shè)備的使用,例如:萬用表、示波器、信號(hào)發(fā)生器、邏輯分析儀等;
8.具有良好的溝通能力,團(tuán)隊(duì)協(xié)作能力,對(duì)待事情認(rèn)真負(fù)責(zé)專注;
工作地點(diǎn)
地址:大連甘井子區(qū)動(dòng)力院環(huán)境中心
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職位發(fā)布者
王醒HR
成都海光核電技術(shù)服務(wù)有限公司
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行業(yè)未知
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成都
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2026-02-04 20:02:04
2347人關(guān)注
注:聯(lián)系我時(shí),請(qǐng)說是在江蘇人才網(wǎng)上看到的。
